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74LS151是常用的8选1数据选择器,芯片内部有一个8选1数据选择器。通过输入不同的地址码C、B、A,可以控制输出Y选择8个输入数据D0~D7中的一个。
连线图和逻辑功能表如下图所示。
S为使能端;
C、B、A为地址输入端;
D0~D7为8选1数据选择器的数据输入端;
Y为输出端。
74LS151输出的逻辑式可以写成:
Y
=
S
′
[
D
0
(
C
′
B
′
A
′
)
+
D
1
(
C
′
B
′
A
)
+
D
2
(
C
′
B
A
′
)
+
(
D
3
C
′
B
A
)
+
D
4
(
C
B
′
A
′
)
+
D
5
(
C
B
′
A
)
+
D
6
(
C
B
A
′
)
+
D
7
(
C
B
A
)
]
Y = S'[D_0(C'B'A') + D_1(C'B'A) + D_2(C'BA') + (D_3C'BA) + D_4(CB'A') + D_5(CB'A) + D_6(CBA') + D_7(CBA)]
Y=S′[D0(C′B′A′)+D1(C′B′A)+D2(C′BA′)+(D3C′BA)+D4(CB′A′)+D5(CB′A)+D6(CBA′)+D7(CBA)]
74LS153是常用的双4选1数据选择器,芯片内部含有两个地址码共用的4选1数据选择器。通过输入不同的地址码B、A,可以控制输出Y选择4个输入数据C0~C3中的一个。
连线图和逻辑功能表如下图所示。
1G、2G为两个独立的使能端;
B、A为公用的地址输入端;
1C0~1C3和2C0~2C3分别为两个4选1数据选择器的数据输入端;
Y1、Y2为两个输出端。
74LS153输出的逻辑式可以写成:
Y
=
G
′
[
C
0
(
B
′
A
′
)
+
C
1
(
B
′
A
)
+
C
2
(
B
A
′
)
+
C
3
(
B
A
)
]
Y = G'[C_0(B'A') + C_1(B'A) + C_2(BA') + C_3(BA)]
Y=G′[C0(B′A′)+C1(B′A)+C2(BA′)+C3(BA)]
若将B、C作为两个输入变量,同时令C0~C3为第三个输入变量的适当状态(包括原变量、反变量、0和1),就可以在数据选择器的输出端产生任何形式的三变量组合逻辑函数。
同理,使用具有n位地址输入的数据选择器,可以产生任何形式输入变量数不大于n+1的组合逻辑函数。
设A为主裁判,B,C,D为副裁判。只有在主裁判同意的前提下,三名副裁判中多数同意,比赛成绩才被承认,否则,成绩不予承认(1为同意,0为不同意)。
(1)用数据选择器(74LS151或74LS153)实现。
(2)用3线-8线译码器(74LS138)和与非门实现。采用74LS138
设计过程:
取主、副裁判A、B、C、D的状态为输入变量,取值为1表示同意,取值为0表示不同意。取比赛成绩为输出变量,以F表示,取值为1时表示成绩被承认,取值为0时表示成绩不被承认。
根据题意可以列出逻辑真值表。
根据上述真值表,写出相应的逻辑函数式:
F
=
A
B
C
+
A
B
D
+
A
C
D
F= ABC+ABD+ACD
F=ABC+ABD+ACD
F = ( ( A B ’ C D ) ’ ( A B C ’ D ) ’ ( A B C D ’ ) ’ ( A B C D ) ’ ) ’ F=((AB’CD)’(ABC’D)’(ABCD’)’(ABCD)’)’ F=((AB’CD)’(ABC’D)’(ABCD’)’(ABCD)’)’
本题可使用逻辑转换仪(使用方法见后面注意事项)进行数据测试,将逻辑转换仪测试结果填入下表。测试结果与表1数据进行对照,验证测试结果是否符合设计要求。
C = C
B = B
A = A
D1 = 0
D0 = 0
D2 = D
D3 = D
D4 = 0
D5 = D
D6 = D
D7 = D’
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