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注意:这里将输出输出参数均指定为AXI_Lite接口,并指定return以创建模块的中断端口。
void adder(int a, int b, int& c) {
#pragma HLS INTERFACE s_axilite port=a
#pragma HLS INTERFACE s_axilite port=b
#pragma HLS INTERFACE s_axilite port=c
#pragma HLS INTERFACE s_axilite port=return
c = a + b;
}
加入ZYNQ IP核,并应用开发板的自动配置,再添加HLS生成的adder模块,使用自动连线就可以生成如下设计。
在
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