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从底层结构开始学习FPGA(7)----进位链CARRY4

进位链

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一、半加器与全加器

1.1、半加器

1.2、全加器

二、多bit加法(以4bit为例)

2.1、串行(行波)进位加法器(RCA)

2.2、超前进位加法器(Carry-Lookahead Adder,CLA)

三、进位链CARRY4

3.1、端口

3.2、内部组成

3.3、推断

3.4、测试实例


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一、半加器与全加器

        FPGA底层的CARRY4本质上就是用来实现最基本的加、减法运算的,在了解CARRY4之前,我们需要对1bit以及多bit的二进制加法及其FPGA实现做一个了解。

        1bit的二进制加法可以分为两类:无底层进位的半加器与有底层进位的全加器。减法运算本质上仍是一种加法运算,在二进制电路中采用加上负数的补码实现。


1.1、半加器

        半加器电路是指对两个输入数据位相加,输出一个结果位和进位,没有进位输入的加法器电路。 

        半加器有两个1位2进制数输入,输出1个进位、1个结果位。真值表如下:

A B Carry Sum
0 0 0 0
1 0 0 1</
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