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wire综合出来是线,用于assign赋值语句中,因为wire是线的意思,在赋值语句中,右边变量发生变化时,左边变量也随之改变。
reg综合出来是寄存器,用在always与initial过程块中,reg是寄存器的意思,在赋值语句中,当右边变量发生变化时,左边的值不会立即发生变化,会有一个时钟周期的延迟。