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FPGA/IC秋招经典100题(含详解)_对11.916无损定点化

对11.916无损定点化

FPGA/IC秋招经典100题(含详解)》

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《FPGA/IC 秋招笔试/面试题总结》
《FPGA/IC 秋招笔试/面试题总结(续)》



1. Verilog语言中,下面哪些语句不可被综合()
    A. #delay语句

    B. initial语句

    C. always语句

    D. 用generate语句产生的代码
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解:

所有综合工具都不支持的结构:time,defparam,$finish,fork,join,initial,delays,UDP,wait
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2. `timescale 1ns/100ps,如下正确的是()
    A. 时间单位是ps

    B. 时间单位是100ps

    C. 时间精度是1ns

   
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