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CLB(Configurable Logic Block)是Xilinx FPGA内部逻辑资源的组成单位。一个CLB由两个Slice构成,这两个slice之间没有直接连接,各自连接到switch matrix走线资源。带有进位逻辑的Slice在纵向级连,下一级的进位输出作为上一级的进位输入。
图 1 Spartan-6(左)、7系列(右)的CLB和Slice
图1分别为Spartan-6(左)和7系列(右)的CLB和Slice之间的连接关系。Xilinx对Slice有一个编号规则,每个Slice的编号为X*Y*。X代表了纵向的列
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