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基于Verilog HDL的数字时钟_verilog数字钟实验报告

verilog数字钟实验报告

一、实验目的

1.学习相关的设计方法及原理
2.学习设计方法

二、实验概述

基于Verilog HDL设计一个时钟
在这里插入图片描述
在这里插入图片描述

三、实验过程

新建一个工程
在这里插入图片描述
选择芯片
在这里插入图片描述
完成

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