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Verilog 数字进制格式包括二进制、八进制、十进制和十六进制,一般常用的为二进制、十进制和十六进制。
- //reg define
- reg [31:0] delay_cnt; //延时计数器
- reg key_flag ; //按键标志
- //wire define
- wire data_en; //数据使能信号
- wire [7:0] data ; //数据
- //parameter define
- parameter DATA_WIDTH = 8; //数据位宽为 8 位
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