modelsim自动仿真环境_modelsim如何添加环境变量

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一、bat文件

二、do文件

一、bat文件

::关键字echo 在DOS屏幕上有打印输出的功能，相当于高级编程语言的print()，参数有on,off。on 表示在从下一行开始命令行显示，off表示从下一行开始关闭命令行显示
@echo off
::清除屏幕。
@cls
::标题
title FPGA  Simulation
::echo ModelSim simulation
::空一行
echo.
::echo Press '1' to start simulation
::echo.
::
:::input
::set INPUT=
::显示Type test number
::set /P INPUT=Type test number: %=%
::如果按下1就执行run1的代码
::if "%INPUT%"=="1" goto run1
::goto end
 
:::run1
::@cls
::echo Start Simulation;
::echo.
::echo.
::打开当前路径下的testbench文件夹
cd testbench
::在系统的环境变量当中path路径中添加了modelsim的安装路径，就会直接调用modelsim，然后执行do compile.do的脚本
vsim -do "do compile.do"
::将 Windows 命令解释程序定向到批处理程序中某个带标签的行
goto clean_workspace
 
:::clean_workspace
 
::rmdir /S /Q work
::del vsim.wlf
::del transcript.
 
:end

二、do文件

#vlog # 编译
#vlib # 建立一个新的工作库/逻辑库
#vmap # 映射逻辑库名到制定的目录
#add wave # 将信号加入波形
#run # 执行仿真（默认执行100ns，-all 执行到结束）
#quit # 退出仿真
# 建立一个新的工作库/逻辑库
vlib work
vmap work work
 
#library编译库
#vlog  -work work ../../library/artix7/*.v
 
#IP编译IP，../表示上一级文件夹
#vlog  -work work ../../../source_code/ROM_IP/rom_controller.v
#vlog  -work work ../vivado_project/project_1/project_1.srcs/sources_1/ip/clk_wiz_0/clk_wiz_0_sim_netlist.v
 
#SourceCode编译VHDL
vlog  -work work ../design/*.v
 
 
#Testbench编译仿真
vlog  -work work sim_tb_top.v 
#把sim_tb_top添加到modelsim中WORE文件夹下
#vsim -voptargs=+acc -L unisims_ver -L unisim -L work -Lf unisims_ver work.glbl work.sim_tb_top
vsim -voptargs=+acc work.sim_tb_top
 
#Add signal into wave window
#运行do wave.do文件
do wave.do
add wave -position insertpoint sim:/sim_tb_top/inst_mod_top/*
#运行仿真
run -all