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DDR4 IP的用户接口_ddr4 ip核
作者：码创造者 | 2024-08-16 12:49:22
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ddr4 ip核
UltraScale架构的FPGA的存储接口解决方案如下图所示。其中IP 核中包括 User Interface Block、Memory Controller、Physical Layer模块。
实验使用的是ZCU106板子，需要使用DDR4的IP 核，在添加了IP核后发现有许多接口，通过查找https://www.xilinx.com/support/documentation/ip_documentation/mig/v5_0/pg150-ultrascale-mis.pdf
https://www.xilinx.com/support/documentation/ip_documentation/ultrascale_mem
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