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实验九 基于FPGA的计数译码显示电路设计_基于fpga的计数译码显示电路设计69的补段
作者：花生_TL007 | 2024-05-29 20:09:57
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基于fpga的计数译码显示电路设计69的补段
基本任务一：利用FPGA硬件平台上的4位数码管做静态显示，用SW0-3输入BCD码，用SW4-7控制数码管位选
m100：
frediv：
decoder：
基本任务二：利用FPGA硬件平台上的4位数码管显示m10技术结果
扩展任务一：对7448译码的6和9进行补段
扩展任务二：用按键控制计数器从0-9计数，4位数码管显示技术结果。
cnt10：
decoder69：
key_bounce:
frediv:
基本任务三：利用FPGA硬件平台上的6位数码管显示模100计数结果。
cnt6：
m100：
frediv：
decoder——69：
m100_2output：
dig_select:
code_select:
display_m100:
cnt6_add
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