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JKD的6-1、6-2课程
72MHZ计算72个数,就是 1MHZ,占用1us的时间。
基本定时器只支持向上计数模式。计数器从零开始向上自增,计数到等于重装载值,清零同时申请中断。
从基本时钟72M 到 控制器 到 预分频器 到 计数器然后和自动重装载值比较。
计数值等于自动重装值就会产生两个方向,向上箭头是通往NVIC到CPU更新中断。向下箭头是通往NVIC到更新事件,可以映射到TRGO连接到DAC(数模转换)。
支持向上计数、向下计数(向下自减到重装载值)、中央对齐方式(向上自增到重装载值,在自减到0)。
下面黑色阴影的寄存器都是带缓冲寄存器的。称之为影子寄存器。
时钟源选择:
1、内部的72M。
2、ETR引脚(外部时钟可以选择外部脉冲输入,即外部方波脉冲输入,相当于计数器)进来可以先滤波对外部时钟进行整形,因为会有一些毛刺。接下来可以走ETRF(外部时钟模式 2),也可以TRGI(触发输入,定时器的从模式)。
3、ITR引脚0-3都是其他的定时器TRGO输入的,TRGI是外部时钟模式1, 可以实现定时器级联功能。
图中最右边是4个通道的输出比较电路 ,左侧是4个通道的输入捕获电路。中间是捕获比较寄存器,是输入捕获和输出比较公用的,因为不能输入捕获和输出比较不能同时使用。
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