Verilog实现模三检测器，设计输入序列能否被三整除，RTL设计+testbenc验证

作者：weixin_40725706 | 2024-04-29 17:28:05

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参考文献：
模三检测器1
模三检测器2

目的：设计模三检测电路，判断输入序列能否被三整除，能，输出是1；不能，不能输出是0。

原理： Mealy型状态机，不只是跟输入有关，还

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