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Verilog HDL实现状态机（一）_状态机verilog
作者：繁依Fanyi0 | 2024-08-01 20:11:54
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状态机verilog
1.状态机简介
状态机简写为FSM（Finite State Machine），也称为同步有限状态机。
分类：Moore型状态机，输出与输入相关，与当前无关；
Mealy型状态机，输出与输入及当前相关；
2.可乐机状态机
可乐机状态机模拟功能：投入3枚硬币，出一瓶可乐；
模块框图如下：
状态转移图如下：
Moore型状态机：
Mealy型状态机：
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