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本文仅对UG471 第3章《Advanced SelectIO Logic Resources》部分进行翻译和学习解读。
其他部分,后续补充。
水平所限,有不足之处,欢迎拍砖。
SERDESE2是专用的串并转换器,它在完成串并转换时并不会带来多余的时序上的问题,从而很适合应用到高速源同步应用中。比如摄像头数据。
它可以完成高速数据传输同时不需要FPGA端匹配数据频率,这个转换器支持SDR(single data rate)和DDR(double data rate)。SDR模式支持2-,3-,4-,5-,6-,7-,8b
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